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405:Pages in category "Electronic design automation"
448:Electronic system-level design and verification
47:
571:Input/output Buffer Information Specification
723:Potential applications of carbon nanotubes
320:Electronic design automation organizations
812:Semiconductor intellectual property core
708:Placement (electronic design automation)
410:This list may not reflect recent changes
599:List of electrical engineering software
939:
827:Signoff (electronic design automation)
360:Satisfiability modulo theories solvers
202:Electronic design automation software
475:Feedback-controlled electromigration
149:
837:Silvaco Data Systems v. Intel Corp.
770:Resolution enhancement technologies
340:Electronic design automation people
13:
911:Universal Verification Methodology
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161:
148:
14:
963:
817:Semiconductor process simulation
18:
239:Hardware verification languages
185:Electronic circuit verification
782:Satisfiability modulo theories
226:Hardware description languages
1:
807:Semiconductor device modeling
698:Physical design (electronics)
681:Open Verification Methodology
480:Fiduccia–Mattheyses algorithm
443:Electronic circuit simulation
384:Timing in electronic circuits
485:Floorplan (microelectronics)
433:Electromagnetic field solver
403:
39:Electronic design automation
7:
647:Multi-project wafer service
10:
968:
894:Transaction-level modeling
32:The main article for this
31:
906:Ultra-large-scale systems
733:Power network design (IC)
576:Integrated circuit layout
748:Programmable logic array
743:Programmable Array Logic
738:Power optimization (EDA)
517:Graphics processing unit
458:Engineering change order
303:Electronics optimization
760:Register-transfer level
620:Low-power FSM synthesis
549:High-level verification
512:Graphical system design
718:Platform-based design
632:Mask data preparation
539:Hardware watermarking
642:Multi-channel length
544:High-level synthesis
534:Hardware obfuscation
952:Digital electronics
862:Symbolic simulation
842:Simulation software
507:Generic Array Logic
259:IEEE DASC standards
857:Substrate coupling
605:Logic optimization
26:Electronics portal
947:Electronic design
923:VISC architecture
797:Schematic capture
664:Network on a chip
502:Gajski–Kuhn chart
279:Network on a chip
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884:Test compression
832:Silicon compiler
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802:Schematic editor
765:Rent's rule
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637:Maze runner
566:IEC 61131-3
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307:(1 C, 20 P)
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206:(4 C, 56 P)
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713:Planar SAT
324:(1 C, 2 P)
792:Schematic
48:Contents
529:Handel-C
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344:(38 P)
263:(10 P)
189:(19 P)
176:(14 P)
787:SCALD
693:PBIST
490:FpgaC
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283:(4 P)
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55:Top
36:is
943::
412:.
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